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Take-YourTime/Introduction-to-Computer-aided-VLSI-Design

This repository contains four programming lab assignments for the "Introduction to Computer-aided VLSI Design" course.

Verilog GitHub ↗

★ 0

stars

AI関連スコア

個人開発度

AIツール痕跡

GitHub Topics

#list-scheduling #university-assignment #verilog #vlsi #very-large-scale-integration

C++

23.1%

Tcl

6.9%

Forth

0.4%

Verilog

69.6%

AI関連スコアは4つの箇所それぞれにAI関連キーワードが現れるかを判定し、該当した配点を合計したものです。算出方法の詳細

リポジトリ名該当なし

説明文 +25 一致: AI

GitHub Topics 該当なし

README冒頭 +20 (スコアから逆算 — README本文は保存していません)

合計 AI関連スコア: 75 / 100

当サイトが追跡している Verilog 製Repoは 2件 (うちAI関連スコア40以上は 1件)。このRepoより スター数が多いのは 0件 (上位 50.0%)、 AI関連スコアが高いのは 0件 (上位 50.0%) です。

アカウント

Take-YourTime

タイプ

User

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所属

National Sun Yat-sen University

Hello, I am a student studying in computer science in Taiwan. My hobby is go hikking and I very enjoy the feeling that comes from solving problem.